Architecte Accélérateurs IA – Co-design Hardware / Software

Au sein des équipes de notre client, acteur majeur de l'électronique et des télécommunications, vous interviendrez sur une plateforme d'IA distribuée en périphérie (edge), où les modèles d'IA tournent sur une flotte de serveurs proches des utilisateurs. Vous serez chargé(e) d'évaluer et de définir l'architecture des accélérateurs IA qui équiperont ces serveurs, en lien avec les fabricants de puces et les équipes logicielles.

Missions Veille et évaluation des architectures d'accélérateurs IA du marché (GPU, NPU, TPU) Analyse des sous-systèmes mémoire (HBM, LPDDR) et de leur impact sur les performances Étude de la chaîne de compilation IA (MLIR, TVM, XLA) et de son adéquation au matériel Démarche de co-design hardware / software pour optimiser le couple modèle / puce Contribution aux réflexions sur les options ASIC Échanges techniques et négociations avec les fondeurs et fabricants de puces Rédaction de recommandations d'architecture et de rapports d'évaluation Profil recherché Diplômé(e) d'une école d'ingénieurs, d'un Bac+5 ou d'un doctorat en électronique, architecture des calculateurs ou informatique, vous justifiez d'au moins 5 ans d'expérience sur l'architecture d'accélérateurs IA, idéalement chez un fondeur, un fabricant de puces ou au sein d'une équipe de compilation IA.

Vous maîtrisez les architectures GPU, NPU ou TPU, les technologies mémoire HBM et LPDDR, et au moins une chaîne de compilation IA (MLIR, TVM, XLA). Une bonne connaissance de la conception ASIC est attendue. Une expérience dans l'univers des semi-conducteurs ou d'une startup IA hardware sera particulièrement appréciée.

Vous utilisez les outils d'IA au quotidien dans votre travail et pouvez en donner des exemples concrets. Doté(e) d'une forte vision système et d'excellentes capacités relationnelles, vous pratiquez un anglais courant, jusqu'au niveau négociation. Enfin vous souhaitez participer au développement d'une société à taille humaine, Great Place To Work et labellisée ECOVADIS.